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示波器超过4通道测量的解决方案27
mayer | 2009-05-19 18:46:06    阅读:1439   发布文章

示波器超过4通道测量的解决方案27

 

大家好!

过去的一周全球形势真是风起云涌,泰国的****组织就能把全国搞得鸡飞狗跳,孟买恐怖袭击的枪声还在我们耳边回响,卡拉季奇又爆发大规模骚乱……

国内的情况似乎也好不到哪去——国美的黄光裕官司缠身,百度的李彦宏出来致歉了,联想的柳传志大谈过冬,连全球第二大的大家都很熟悉的伟创立也开始忙着裁员了……

(有消息称伟创立北京研发部门被全部裁掉,连部门经理也未能幸免,北京其他部门还要裁员30%)

林林总总,岂是一个“多事之秋”了得?我们生活在一个怎样的时代?当然,这些大事件离我们的生活太远了,也不是我等小民所能左右的。不知若干年后我们的子孙是否会会读到这段历史?是否会对我们现在的这个世界感到可笑?或许教科书上还有只言片语,或许只字未提。在历史面前我们这些凡夫俗子无非就是空气而已。还是现在过好自己的小日子更重要。


有个朋友每天从台湾给我个“产业新讯”,这段时间以来,铺天盖地的负面消息,满眼看到的不是亏损就是裁员,刚开始还看得心惊肉跳,现在我都懒得打开了,实在是受够了那些可恶的字眼!

但,不管你愿意不愿,总有些事情居心叵测的每天在你我的身边上演着。就在这个周末,我的一个高中同学,就职于令人羡艳的Google公司的高级白领,居然公司lay-off掉了,听说这样的偷偷摸摸行为害在继续。还有个更富戏剧性的故事,我有个朋友在号称全球最大的玩具公司美泰上班,周三晚上我们通电话我还开玩笑的说你们怎么还没有被裁掉啊,他说他们组最近一直很忙,就算裁员暂时也裁不到他们头上,而到了周四下午接到他的电话,被告知裁员——周五离开公司。这家伙周末几次打电话勒索我,不停的说要找我索赔。

狄更斯在《双城记》的开头说:“这是最好的时代,这是最坏的时代;这是智慧的时代,这是愚蠢的时代;这是信仰的时期,这是怀疑的时期;这是光明的季节,这是黑暗的季节;这是希望之春,这是失望之冬;人们面前有着各样事物,人们面前一无所有;人们正在直登天堂,人们正在直下地狱。”

用这段与朋友们互相鼓励,大家抱在一起互相温暖,共同度过这个冬天,我想在我们面前等着的一定是很灿烂的春天!

不管这个冬天有多冷,工作还是要继续,生活还是在继续着,只有我们自己变得更strong,才能安然无恙的渡过任何寒冬。


力科的示波器可是不论严冬与酷暑的在全球各地部分昼夜地在帮工程师捕获信号,观察波形,分析解决问题。 呵呵!

上周我接到一个电话,询问我关于用频谱方法如何计算Rj的。突然之间,好像流行起了“抖动热”。我得同事在同一个小时之内收到两份邮件,都是和抖动相关的问题。 当然,这种问题一般都来之于通信行业的两大公司。 在PC行业是大规模化的工业生产,一致性测试是永恒的主题,似乎除了Intel之外没有多少人去关心眼图是怎么形成的,抖动是怎么测试的。 跟着Intel就是了。 通信行业的门槛似乎高一些,工程师们的思想没有Intel的测试规范指导,天马行空。也许这个行业没有Intel的类似统治是一种幸事,工程师们享受这种思维的乐趣真的很美啊!


下面我将这些问题列在下面,征求热心的读者给出您的答案。 这些问题令我同事感慨不已,因为在三年前,华为的工程师(包括部分Foxconn的工程师)几乎都是在用触发上升沿,然后用模拟余辉看下降沿的变化范围的方法在测试抖动。 今天不一样了,力科在教会工程师用更深入全面的方法在测量抖动。 敏于思考抖动相关问题的工程师也多了起来。
   

1,我在测试信号速率的时候有两种测试方法,直接用bit rate功能测试(2.499989G),也可以用frequency@level 选择data 来测试(2.49753G),
测试的结果差别非常大,一个可以满足要求,而另一个则不满足要求,请问为什么,哪种测试更准确一些。

2,如果我想测试数据信号的最小周期(1个UI的大小),有没有类似测试bit rate的方法直接测试?因为如果使用period@level,同样不准确,与要求相去甚远。

3,在测试信号边沿的上升/下降时间的时候,跟我选择的存储深度有没有关系。比如我使用40GS/S的采样率,测试PCIE CLK,如果在屏幕上显示一个时钟周期测试它的上升下降时间 和 我调节时基 到8M的存储深度时测试到的上升下降时间有没有区别?

4,在测试抖动的时候TJ总显示当前值,最大值和最小值都随当前值的变化而变化,同时变大或同时变小,并没有达到所谓最大值和最小值的目的,这样,如果某瞬间下,总抖动超标,而我刚好不在场,等我看的时候总抖动又正常了,而最大值并没有记录下超标的状态,容易造成漏测!

5,大多数高端示波器都提供了两种时钟恢复中的一种方法,即基于软件的时钟恢复或基于硬件的时钟恢复。 在抖动测试中会有什么不同的表现?

6,TIE测试既然是和标准时钟的比较,这个标准时钟来源于哪里?是什么原理?会影响抖动测量值吗?

7,Rj抖动是怎么测出来的? 是通过TIE抖动减去Dj 然后除以14的出来的吗? 高斯分布图里的数据是以Rj为样本吗?高斯分布是针对随机事件来讲的,如果以Tj为样本,里面有确定性数据,合理吗?

8,现在我们背板的槽位之间预留了很多互联的信号,这些信号目前无法遍历测试。另外,背板的设计目标是6.5G,但当前我们系统上跑的速率是1.25G。
为了验证背板能否满足设计目标,我们需要使用6.5G的信号遍历所有的互联线。 对于以上的情况,有什么好的建议?业界一般是如何测量的? 高速信号如何引到示波器比较好? 有没有一些专门的高速信号引线组件,夹具等? 我们计划做一些测试插板,把背板的信号引出来,能否给我们推荐一些插接件以及测试插板的设计注意事项?


    这周的话题是我同事就上周给大家提出的问题写的一篇短文章。抛砖引玉,希望能引起大家更多的思考。

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